Data-Retention-Voltage-Based Analysis of Systematic Variations in SRAM SEU Hardness: A Possible Solution to Synergistic Effects of TID
0Citations signalées, ce qui n’est pas une note de qualité
0Institutions déclarées
0Pays d’affiliation déclarés
Résumé indisponible. Les résultats de l’étude ne doivent pas être déduits de son seul titre.
Le contrôle bibliographique ouvert
Aucun DOI disponible pour le contrôle Crossref.
Les sujets associés
VLSI and Analog Circuit TestingIntegrated Circuits and Semiconductor Failure AnalysisLow-power high-performance VLSI design